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Topic
计组与微机控制
当前专题共收录 67 个入口。
计组
汇编
微机控制
1.计算机体系结构 CPU 架构和指令集
1.2程序执行的过程和 1.3计算机指令
1.4计算机体系结构中的组成
1.5寄存器传输语言 RTL 和指令格式
1.6计算机的性能指标
2.1数据的表示和运算
2.2字符与字符串
2.3存储程序计算机结构简图以及运算器件
2.4的误区
2.4 流控制与对应条件码寄存器
2.5寄存器编码和寻址方式和 ARM 寄存器集
3.1算术指令
3.2移位操作与流控制
3.3移位操作和流控制
3.4流控制与分支指令和立即数
3.5 寄存器间接寻址
3.6 load 与 store 编码的示例
3.7 子程序与栈
3.8 数据组织
3.9 块移动和数据存储
4.0 异常模式
4.1 MIPS 分支流控制和存储器
4.2 SRAM6116
4.3 SRAM6264 和 DRAM 2164A
4.4 Intel 2164A 和 ROM
4.5 Cache 和主存容量扩展技术
4.6 并行主存系统与 8086 CPU
5.0 ARM 指令系统和 x86 汇编
5.1 ARM 指令系统和总线
5.2 8086/8088 处理器寄存器
5.3 8086/8088 的体系结构
5.4 总线结构和时序
5.4 番外:先衔接后续的 x86,之后再跳回总线
5.5 显式隐式
5.6 段寄存器、指令寄存器和标志寄存器
5.7 标志寄存器续
5.8 逻辑段和物理内存
5.9 当前段、逻辑地址与物理地址
6.0 32位微处理器
6.1 8086和最小模式最大模式
6.2 8086CPU状态、锁存与时钟使能
6.3 特殊引脚和工作模式
6.4 8282、8284A、8286
6.5 CPU工作时序
6.6 时序章节总结和技术发展
7.0 x86指令系统和一些后期展望
7.1 x86寻址方式
7.2 转移寻址
7.3 数据传送指令
7.4 数据传送指令续
7.5 算术类指令
7.6 BCD调整和逻辑运算
7.7 移位循环和串操作
7.8 串操作和条件转移
7.9 循环控制指令和中断指令
第七章习题
8.0 从 ISA 到 AGP 的总线发展
8.1 PCI和AGP总线
8.2 外总线简介
8.3 USB控制总线
8.4 CAN和I2C总线
9.0 异常和中断的概念以及中断来源和管理
9.1 中断向量表和中断源以及优先级
9.2 抢占优先级和中断完整过程
9.3 异常响应和返回以及最终总结
10.0 输入输出技术和编址方式以及DMA技术
10.1 X86中断系统在IO应用